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등록 패리티 비트 LLR 계산을 통한 MAP 알고리즘 및 반복 복호 방법

패리티 비트 LLR 계산을 통한 MAP 알고리즘 및 반복 복호 방법
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발명자
전인산, 김혁, 조한진, 구본태, 엄낙웅
출원번호
10-2010-0115080 (2010.11.18) KIPRIS
공개번호
10-2011-0070778 (2011.06.24)
등록번호
10-1441009-0000 (2014.09.05)
출원국
대한민국
협약과제
초록
본 발명은 터보 복호를 위한 패리티 생성 장치 및 MAP 장치에 관한 것으로서, 구체적으로 본 발명의 터보 복호를 위한 패리티 생성 장치는 인코더(encoder) 상태에 따른 정보 비트에 대한 순방향 및 역방향 상태 메트릭과 입력 심볼간의 관계를 유지 또는 변경함으로써 상기 정보 비트에 대한 순방향 및 역방향 상태 메트릭을 이용하여 패리티 비트에 대한 순방향 및 역방향 상태 메트릭을 계산하는 패리티 상태 메트릭 연산부; 및 상기 패리티 상태 메트릭 연산부에서 계산한 패리티 비트에 대한 순방향 및 역방향 상태 메트릭을 이용해 패리티 비트를 계산하는 패리티 계산부를 포함한다.
KSP 제안 키워드
MAP algorithm, Parity bit, decoding method, iteration decoding
패밀리
 
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등록 터보 복호를 위한 패리티 생성 장치 및 MAP 장치 미국