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상세정보

등록 아날로그 위상에러보상기를 장착한 프랙셔널 디지털 PLL

아날로그 위상에러보상기를 장착한 프랙셔널 디지털 PLL
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발명자
이자열, 유현규, 김성도
출원번호
10-2010-0134101 (2010.12.23) KIPRIS
공개번호
10-2012-0072261 (2012.07.03)
등록번호
10-1695311-0000 (2017.01.05)
출원국
대한민국
협약과제
초록
본 발명은 아날로그 위상에러 보상기를 장착한 프랙셔널 디지털 위상고정루프에 관한 것으로서, 디지털 위상고정루프에 아날로그 위상에러 보상기를 장착하여 아날로그 위상에러 보상기를 통해 미세위상에러 검출 및 보상을 수행함으로써 위상에러 검출해상도를 높이고 과도 전력소모와 전원노이즈 및 과도전류노이즈를 줄일 수 있을 뿐만 아니라 면적을 줄일 수 있다.
KSP 제안 키워드
Digital PLL, Error Compensation, phase error, phase-error compensation
패밀리
 
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등록 아날로그 위상에러 보상기를 장착한 프랙셔널 디지털 위상고정루프 미국