본 발명은 칩 내에서 복수의 프로세서가 동일 메모리로부터 프로그램을 읽을 경우, 캐시 메모리에 의해 발생하는 명령어 및 데이터의 일치성을 유지하는 캐시 제어 장치 및 방법에 관한 것이다. 본 발명에 따른 캐시 제어 장치는 명령어 캐시에 포함되고, 명령어 캐시의 라인 별로 변경, 배타, 공유, 무효 상태 중 적어도 어느 하나를 저장하는 MESI 레지스터를 포함하는 코히런시 제어부 및 코히런시 제어부와 연결되어, 명령어 캐시와 타 캐시의 브로드캐스트 주소 정보, 리드(read) 또는 라이트(write)정보, 히트(hit) 또는 미스(miss) 정보를 송수신하는 코히런시 인터페이스부를 포함 한다. 또한, 본 발명에 따른 캐시 제어 방법은 태그 메모리 컨트롤러로부터 명령어 캐시의 히트 또는 미스 신호를 수신하는 히트/ 미스 수신 단계와, 수신한 히트 또는 미스 신호에 기초하여 코히런시 인터페이스로 브로드캐스트 주소 정보, 리드 또는 라이트 정보, 히트 또는 미스 정보를 타 캐시로 송신하는 송신 단계와, 코히런시 인터페이스를 통하여 타 캐시의 브로드캐스트 주소 정보, 리드 또는 라이트 정보, 히트 또는 미스 정보를 수신하는 수신 단계 및 수신한 브로드캐스트 주소 정보, 리드 또는 라이트 정보, 히트 또는 미스 정보를 분석하여 명령어 캐시의 상태 정보를 변경하고, 리드 스타트 또는 라이트 스타트 명령 신호를 전송하는 상태 변경 및 스타트 명령 신호 전송 단계를 포함한다.
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<출처표시방법 안내> 작성자, 저작물명, 출처, 권호, 출판년도, 이용조건 [예시1] 김진미 외, "매니코어 기반 고성능 컴퓨팅을 지원하는 경량커널 동향", 전자통신동향분석, 32권 4호, 2017, 공공누리 제4유형 [예시2] 심진보 외, "제4차 산업 혁명과 ICT - 제4차 산업 혁명 선도를 위한 IDX 추진 전략", ETRI Insight, 2017, 공공누리 제 4유형
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