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학술대회 고속 DRAM 메모리 데이터 송수신을 위한 클럭 신호의 Duty Cycle Monitor 회로 설계
Cited - time in scopus Download 4 time Share share facebook twitter linkedin kakaostory
저자
조민형, 전영득, 김이경, 박수진, 권영수
발행일
202306
출처
대한전자공학회 학술 대회 (하계) 2023, pp.190-191
협약과제
23HS1900, 프로세서와 고속적층 메모리 통합 PIM 프로세서 구조 및 반도체 개발, 엄낙웅
KSP 제안 키워드
Duty cycle(DC)